ADN4654
ADN4654
新規設計に推奨5kV RMS/3.75kV RMS、デュアルLVDSギガビット・アイソレータ(0リバースチャンネル)
- 製品モデル
- 4
- 1Ku当たりの価格
- 最低価格:$7.18
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製品の詳細
- 5kV rmsおよび3.75kV rms LVDSアイソレータ
- TIA/EIA-644-A LVDS規格に準拠
- 複数のデュアルチャンネル構成
- 低ジッタで最大1.1Gbpsスイッチングまでの任意のデータ・レート
- 4ナノ秒(代表値)の伝搬遅延
- 2.6ps rms(代表値)のランダム・ジッタ、rms
- 1.1Gbpsで90ps(代表値)のピークtoピーク合計ジッタ
- 電源:2.5V/3.3V
- −75dBc電源リップル除去、位相スプリアス・レベル
- グリッチ耐性
- 絶縁バリアをまたぐ±8kV IEC 61000-4-2 ESD保護
- 高いコモンモード過渡耐圧:>25kV/μs
- 1.1Gbps PRBSでEN 55022クラスBの放射エミッション制限をクリア
- 安全性と規制に対する認定(20ピンSOIC_Wパッケージ)
- UL(申請中):1分間で5000V(実効値)、UL 1577規格に準拠
- CSA Component Acceptance Notice 5A(申請中)
- VDE適合性認定(申請中)
- DIN V VDE V 0884-10(VDE V 0884-10):2006-12
- VIORM = 424VPEAK
- 開放、短絡、および終端している入力状態に対しフェイルセーフの出力「ハイ」(ADN4655/ADN4656)
- 動作温度範囲:−40°C~+125°C
- 7.8mmの沿面距離とクリアランス(最小)
ADN4654/ADN4655/ADN46561は、最大1.1Gbpsで動作する、低ジッタの信号絶縁型の低電圧差動伝送(LVDS)バッファです。このデバイスには、アナログ・デバイセズの高速動作用に強化されたiCoupler®技術が採用されており、TIA/EIA-644-A準拠のLVDSドライバとレシーバーに対応した電気的絶縁を提供します。これにより、LVDSシグナル・チェーンのドロップイン絶縁が可能になります。
ADN4654/ADN4655/ADN4656は複数チャンネル構成に対応しています。また、ADN4655およびADN4656のLVDSレシーバーはフェイルセーフ機構を採用しており、入力がフロート状態、短絡、または終端処理済みであるが、駆動されていない場合に、対応するLVDSドライバ出力が確実にロジック1になります。
低いジッタで高速動作を実現できるようにLVDS回路と絶縁回路は2.5V電源を使用します。内蔵の低ドロップアウト・レギュレータ(LDO)は、必要な2.5Vを外部の3.3V電源から供給できます。このデバイスは、広範な工業用温度範囲にわたって完全に仕様規定されており、5kV rms絶縁の20ピン、ワイド・ボディSOIC_Wパッケージ、または3.75kV rms絶縁の20ピン、SSOPパッケージを採用しています。
アプリケーション
- 隔離されたビデオとイメージング・データ
- アナログ・フロントエンド絶縁
- データ・プレーンの絶縁
- 絶縁型高速クロックとデータ・リンク
1米国特許5,952,849; 6,873,065; 6,903,578; 7,075,329により保護されています。その他の特許は申請中です。
ドキュメント
データシート 2
ユーザ・ガイド 1
技術記事 1
安全性および規制遵守 1
ビデオ 13
安全性および規制遵守 1
ソリューション・カタログ 1
珍問/難問集 1
Analog Dialogue 1
製品モデル | ピン/パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
---|---|---|---|
ADN4654BRSZ | 20-Lead SSOP | ||
ADN4654BRSZ-RL7 | 20-Lead SSOP | ||
ADN4654BRWZ | 20-Lead SOIC (Wide) | ||
ADN4654BRWZ-RL7 | 20-Lead SOIC (Wide) |
これは最新改訂バージョンのデータシートです。
ツールおよびシミュレーション
LTspice 1
IBISモデル 1
LTspice®は、無料で提供される強力で高速な回路シミュレータと回路図入力、波形ビューワに改善を加え、アナログ回路のシミュレーションを容易にするためのモデルを搭載しています。
評価用キット
リファレンス・デザイン
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