AD9695

推荐新设计使用

14 位、1300 MSPS/625 MSPS、JESD204B 双通道模数转换器

数据手册 (Rev. c)
产品模型
4
产品技术资料帮助

ADI公司所提供的资料均视为准确、可靠。但本公司不为用户在应用过程中侵犯任何专利权或第三方权利承担任何责任。技术指标的修改不再另行通知。本公司既没有含蓄的允许，也不允许借用ADI公司的专利或专利权的名义。本文出现的商标和注册商标所有权分别属于相应的公司。
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产品详情

  • JESD204B（子类 1）编码串行数字输出
    • 线速高达 16 Gbps
  • 1300 MSPS 时总功率为 1.6 W
    • 每个 ADC 通道 800 mW
  • 172 MHz 时 SNR = 65.6 dBFS（1.59 V p-p 输入范围）
  • 172.3 MHz 时 SFDR = 78 dBFS（1.59 V p-p 输入范围）
  • 噪声密度
    • −153.9 dBFS/Hz（1.59 V p-p 输入范围）
    • −155.6 dBFS/Hz（2.04 V p-p 输入范围）
  • 0.95 V、1.8 V 和 2.5 V 电源供电
  • 无失码
  • 内部 ADC 基准电压源
  • 灵活的输入范围
    • 1.36 V p-p 至 2.04 V p-p（典型值为 1.59 V p-p）
  • 2 GHz 可用模拟输入全功率频宽
  • >95 dB 通道隔离/串扰
  • 用于高效 AGC 实施的幅度检测位
  • 每个 ADC 通道具有 2 个集成式数字降频器
    • 48 位 NCO
    • 可编程抽取率
  • 差分时钟输入
  • SPI 控制
    • 具有除以 2 和除以 4 选项的整数时钟
    • 灵活的 JESD204B 线配置
  • 片内抖动，可提高微弱信号线性度
AD9695
14 位、1300 MSPS/625 MSPS、JESD204B 双通道模数转换器
AD9695 Functional Block Diagram AD9695 Pin Configuration
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软件资源

器件驱动器 1

硬件生态系统

部分模型 产品周期 描述
Clocks 2
LTC6951
最后购买期限 具集成型 VCO 的超低抖动、多输出时钟合成器
LTC6953
最后购买期限 具有 11 个输出并支持 JESD204B/JESD204C 协议的超低抖动、4.5GHz 时钟分配器
Fanout Buffers & Splitters 2
LTC6955
最后购买期限 超低抖动 7.5GHz 11 输出扇出缓冲器系列
HMC7043
推荐新设计使用

高性能、3.2 GHz、14输出扇出缓冲器

PLL Synthesizers 3
LTC6952
最后购买期限 具有 11 个输出并支持 JESD204B / JESD204C 协议的超低抖动、4.5GHz PLL
HMC7044
推荐新设计使用 带JESD204B接口的高性能、3.2 GHz、14路输出抖动衰减器
AD9528
推荐新设计使用 提供14路LVDS/HSTL输出的JESD204B/JESD204C时钟发生器
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工具及仿真模型

Virtual Eval - BETA

Virtual Eval是一款网络应用程序，可帮助设计人员评估ADC和DAC产品。 利用ADI公司服务器上的详细模型，Virtual Eval在几秒内可仿真关键部件的性能特征。 对工作条件（如输入音和外部抖动）以及器件特性（如增益或数字下变频）进行配置。 性能特征包括噪声、失真和分辨率、FFT、时序图、频率响应图等。

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IBIS 模型 1

AD9208/AD9689/AD9694/AD9695 AMI Model

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ADC Companion Transport Layer RTL Code Generator Tool

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

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S-参数 1

LTspice

LTspice®是一款强大高效的免费仿真软件、原理图采集和波形观测器，为改善模拟电路的仿真提供增强功能和模型。

评估套件

eval board
schematic 1
schematic 2
schematic 3
EVAL-AD9695

AD9695 评估板

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特性和优点

  • 适用于 AD9695-1300/AD9695-625 的功能完备的评估板。
  • JESD204B 编码串行数字输出，支持高达每线 16Gbps 的线速。
  • 宽泛的全功率频宽支持对高达 2GHz 的信号进行 IF 采样。
  • 四个集成宽频抽取滤波器和 NCO 模块支持多频段接收器。
  • 灵活的 SPI 接口控制多种不同的产品特性和功能，以满足特定的系统要求。
  • 可编程的快速超范围检测和信号监测。

产品详情

AD9695-1300EBZ/AD9695-625EBZ支持14位、1300MSPS/625MSPS双通道模数转换器(ADC) AD9695。该器件内置片内缓冲器和采样保持电路，专门针对低功耗、小尺寸和易用性而设计。该器件设计支持高达2 GHz的直接RF采样模拟信号。AD9695针对宽输入带宽、高采样速率、出色的线性度和小封装低功耗而优化。

本参考设计提供在各种模式和配置下运行该ADC所需的全部支持电路。它设计为可直接与ADS7-V2EBZ数据捕获卡接口，允许用户下载捕获的数据进行分析。现可使用ACE 软件包实现器件控制和后续数据分析。

由于除功耗外性能相同，AD9695-1300EBZ可用于评估AD9697。

eval board
schematic 4
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ADS8-V1EBZ

ADS8-V1 评估板

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特性和优点

  • Xilinx Kintex Ultrascale XCKU040-3FFVA1156E FPGA。
  • 一(1)个FMC+连接器。
  • 一(1)个FMC+连接器支持的二十(20)个16Gbps收发器。
  • DDR4 SDRAM。
  • 简单的USB 3.0端口接口。

产品详情

连接到指定的 ADI 高速 ADC 评估板时，ADS8-V1 可用作数据采集板。ADS8-V1 上的 FPGA 设计用于支持最高速 JESD204B 模数转换器，可充当数据接收器，同时 ADC 为数据发射器。
EVAL-AD9695
AD9695 评估板
AD9695-1300EBZANGLE-web AD9695-1300EBZBOTTOM-web AD9695-1300EBZTOP-web
ADS8-V1EBZ
ADS8-V1 评估板
ADS8-V1EBZANGLE-web ADS8-V1EBZBOTTOM-web ADS8-V1 Evaluation Board (top)

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