AD9697

推荐新设计使用

14 位 1300 MSPS JESD204B 模数转换器

产品模型
2
产品技术资料帮助

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产品详情

  • JESD204B(子类 1)编码串行数字输出
    • 线速高达 16 Gbps
  • 1300 MSPS 时总功率为 1.01 W
  • 172 MHz 时 SNR = 65.6 dBFS(1.59 V p-p 输入范围)
  • 172.3 MHz 时 SFDR = 78 dBFS(1.59 V p-p 输入范围)
  • 噪声密度
    • −153.9 dBFS/Hz(1.59 V p-p 输入范围)
    • −155.6 dBFS/Hz(2.04 V p-p 输入范围)
  • 0.95 V、1.8 V 和 2.5 V 电源供电
  • 无失码
  • 内部 ADC 基准电压源
  • 灵活的输入范围
    • 1.36 V p-p 至 2.04 V p-p(典型值为 1.59 V p-p)
  • 2 GHz 可用模拟输入全功率频宽
  • 用于高效 AGC 实施的幅度检测位
  • 4 个集成式数字降频器
    • 48 位 NCO
    • 可编程抽取率
  • 差分时钟输入
  • SPI 控制
    • 具有除以 2 和除以 4 选项的整数时钟
    • 灵活的 JESD204B 线配置
  • 片内抖动,可提高微弱信号线性度
AD9697
14 位 1300 MSPS JESD204B 模数转换器
AD9697 Functional Block Diagram AD9697 Pin Configuration
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软件资源


硬件生态系统

部分模型 产品周期 描述
Clocks 2
LTC6951 最后购买期限 具集成型 VCO 的超低抖动、多输出时钟合成器
LTC6953 最后购买期限 具有 11 个输出并支持 JESD204B/JESD204C 协议的超低抖动、4.5GHz 时钟分配器
Fanout Buffers & Splitters 2
LTC6955 最后购买期限 超低抖动 7.5GHz 11 输出扇出缓冲器系列
HMC7043 推荐新设计使用

高性能、3.2 GHz、14输出扇出缓冲器

PLL Synthesizers 3
LTC6952 最后购买期限 具有 11 个输出并支持 JESD204B / JESD204C 协议的超低抖动、4.5GHz PLL
HMC7044 推荐新设计使用 带JESD204B接口的高性能、3.2 GHz、14路输出抖动衰减器
AD9528 推荐新设计使用 提供14路LVDS/HSTL输出的JESD204B/JESD204C时钟发生器
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工具及仿真模型

ADC Companion Transport Layer RTL Code Generator Tool

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

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